MIKROKOMPUTERY JEDNOUKŁADOWE RODZINY MCS - 51

Wielkość: px
Rozpocząć pokaz od strony:

Download "MIKROKOMPUTERY JEDNOUKŁADOWE RODZINY MCS - 51"

Transkrypt

1 INSTYTUT AUTOMATYKI POLITECHNIKI ŁÓDZKIEJ HENRYK MROCZEK MIKROKOMPUTERY JEDNOUKŁADOWE RODZINY MCS - 51 ŁÓDŹ 1995

2 Spis treści 1.Charakterystyka ogólna 3 2.Opis budowy i działania Architektura Przestrzeń adresowa pamięci ROM, RAM, SFR Rejestry podstawowe procesora Pamięć RAM Rejestry SFR Porty P0...P Programowalne układy czasowe Układ transmisji szeregowej System przerwań Inicjalizacja i stan uśpienia procesora 40 3.Cykl maszynowy i rozkazowy procesora 42 4.Możliwości rozbudowy systemu MCS Lista instrukcji Uwagi do listy instrukcji Opis instrukcji 48 2

3 1.Charakterystyka ogólna Mikrokomputerami jednoukładowymi nazywana jest pewna klasa mikroprocesorów charakteryzująca się tym, że w jednym układzie scalonym zawarty jest procesor, pamięć programu, pamięć danych, jeden lub kilka liczników programowalnych oraz układy (porty) wejściowo-wyjściowe umożliwiające bezpośrednie przyłączanie urządzeń zewnętrznych. Ze względu na ograniczoną pojemność pamięci (np.4kb pamięci programu i 256 bajtów pamięci danych ) układy takie przeznaczone są do realizacji niezbyt złożonych układów sterowania (np. sterowanie krosnem ) lub dość złożonych, inteligentnych przyrządów pomiarowych (takich jak np. uniwersalny miernik mierzący napięcie, prąd, moc czynną, bierną i cosϕ). Mikrokomputery jednoukładowe nazywane są też często mikrokontrolerami. W dalszej części niniejszego opracowania będą nazywane także mikroprocesorami lub po prostu procesorami. W grupie mikroprocesorów 8-bitowych najbardziej rozpowszechnione są w chwili obecnej układy firmy INTEL należące do rodziny MCS-51 (ang. MCS-Microcomputer System) oraz 68HC11 firmy MOTOROLA. Mikroprocesory firmy INTEL są produkowane przez szereg innych firm, jak np. PHILIPS, SIEMENS, AMD, FUJITSU. Podstawowym układem rodziny MCS-51 jest procesor Wykonywany jest on w dwóch wersjach : w technologii HMOS i w technologii CHMOS. Ta druga wersja oznaczana jest symbolem 80C51 i charakteryzuje się znacznie mniejszym poborem mocy a ponadto posiada dwa reżimy pracy w stanie tzw. uśpienia (ang. Power Down Mode), w których pobór mocy ulega dalszemu zmniejszeniu, umożliwiając stosowanie zasilacza bateryjnego, co jest szczególnie ważne w przyrządach przenośnych. Mikroprocesor 8051 zawiera oprócz jednostki centralnej (ang.cpu-central Processing Unit) także pamięć programu ROM (ang. Read Only Memory) o pojemności 4kB, pamięć danych RAM (ang. Random Access Memory) o pojemności 128 bajtów, dwa 16-bitowe liczniki programowalne (ang. Counter/Timer), układ transmisji szeregowej oraz cztery 8-bitowe porty wejściowo wyjściowe (ang. I/O - Input/Output Ports). Procesor wyposażony jest w 5 wejściowy system przerwań (2 przerwania zewnętrzne, dwa od liczników, jedno od portu szeregowego). Przerwania te są dwupoziomowe, tzn. o dwóch poziomach zagnieżdżenia. 3

4 Częstotliwość impulsów zegarowych taktujących pracę procesora może zawierać się w granicach: mhz. Procesor umożliwia bezpośrednie przyłączenie rezonatora kwarcowego, zazwyczaj o częstotliwości 12 MHz. Lista instrukcji obejmuje 111 pozycji. Instrukcje mogą być 1, 2, 3- bajtowe, przy czym większość z nich (58%) wykonywana jest w czasie 1 µs a pozostałe w czasie 2µs - przy częstotliwości zegara 12MHz. Przedstawiona wyżej charakterystyka oddaje w pierwszym przybliżeniu podstawowe właściwości procesora Procesor 8051 posiadający wewnętrzną pamięć programu ROM stosowany jest wtedy, gdy po zbudowaniu układu prototypowego i wszechstronnym zweryfikowaniu programu użytkownik zdecydował się na zamówienie dużej serii (co najmniej 1000 sztuk) mikroprocesorów. W tym przypadku zamawia się u producenta procesor z pamięcią ROM programowaną maską (specyfikację maski dostarcza się producentowi). Do celów budowy urządzeń prototypowych można wykorzystać procesor 8751 z pamięcią EPROM umożliwiającą zaprogramowanie jej (i skasowanie promieniami ultrafioletowymi) co najmniej kilkanaście razy. Tego rodzaju procesory są jednak stosunkowo drogie. Z tego względu do budowy urządzeń prototypowych wykorzystuje się najczęściej procesor 8031 bez wewnętrznej pamięci programu. W tym przypadku pamięć programu EPROM dołącza się z zewnątrz. Pojemność tej pamięci może wynosić max. 64kB. Procesor ten umożliwia przyłączenie także zewnętrznej pamięci RAM o pojemności do 64kB. Przy korzystaniu z pamięci zewnętrznej (RAM lub EPROM) traci się jednak znaczną liczbę linii wejściowo -wyjściowych, gdyż do tego celu trzeba zaangażować więcej niż dwa 8-bitowe porty procesora (18 linii we-wy). W tym przypadku zazwyczaj zachodzi potrzeba dołączenia zewnętrznych portów I/O (np. LS373, LS245), które wchodzą do przestrzeni adresowej pamięci zewnętrznej RAM, co odpowiednio zmniejsza użytkowany obszar pamięci. Pomimo tych ograniczeń urządzenia prototypowe projektowane są zazwyczaj przy wykorzystaniu procesorów nie posiadających wewnętrznej pamięci ROM. Do rodziny MCS-51 zalicza się także procesor 8052 i jego pochodne, które można oznaczyć ogólnie 8xx2. Procesory należące do tej rodziny (Tab.1) charakteryzują się tym, że mają dwukrotnie większą pamięć RAM (256 bajtów) oraz jeden dodatkowy licznik 16-bitowy (razem trzy) i jedno dodatkowe źródło przerwań. 4

5 Procesory zestawione w Tabeli 1 i oznaczone symbolami 8xx1,8xx2 tworzą tzw. zestaw podstawowy. Ten właśnie zestaw zostanie dalej opisany szczegółowo na przykładzie procesorów 8031 i Tab.1. Mikrokomputery rodziny zestaw podstawowy Typ Zegar Wewnętrzna Wewnętrzna Porty (MHz) pamięć programu pamięć RAM I/O Liczniki Przerwania Liczba (w bajtach) (w bajtach) 8-bitowe 16-bitowe /poziomy końcówek 8051,80C51 4k ROM 8751,87C k EPROM / ,80C ,80C52 8k ROM 8752, 12 8k EPROM / ,80C32 - Jak już wspomniano, rodzina MCS-51 jest dalej rozwijana i osiągalne są procesory bogaciej wyposażone, ale też i znacznie droższe. Tab.2. Zaawansowane mikroprocesory rodziny 8051 firmy Philips (PCB) i Siemens (SAB) Zegar (MHz) PCB Wewn. pam.ram (w bajtach) 80C SAB SAB Porty I/O 8-bitowe Liczniki 16-bit. Przerwania /poziomy 5(I/O) + 1(I) 2 15/2 6(I/O) + 1(I) 2 6/2 80C535 12, /4 SAB 7(I/O) + 80C / 2 (I) 4 14/4 ADC PWM Watchdog Wskaźniki DPTR Układ mnoż./ dziel. Liczba końcówek 8we /10bit we /8bit we /8bit we /8bit tak 84 W tabeli 2 zestawiono kilka wybranych procesorów z tej grupy jednak dla uproszczenia nie umieszczono ich odpowiedników z pamięcią ROM lub EPROM. Wszystkie te procesory korzystają z podstawowej listy instrukcji procesora Z tabeli 2 widać że wyszczególnione w niej procesory mają większą liczbę portów 5

6 I/O, większą liczbę liczników 16-bitowych, większą liczbę wejść przerwaniowych i większą liczbę poziomów zagnieżdżenia. Niektóre z mikroprocesorów wyposażone są w przetworniki analogowo-cyfrowe 8 lub 10-bitowe, a także wyjścia typu PWM (ang. Pulse Width Modulation) generujące przebiegi o stałej częstotliwości i współczynniku wypełnienia sterowanym cyfrowo. Procesory te wyposażone są też w tzw. Watch-dogi, czyli układy czuwające nad tym, czy wykonywane są prawidłowo pewne pętle programowe i zgłaszające przerwania przy wykryciu błędu. W jednym z najbardziej zaawansowanych procesorów (SAB80C537) wbudowano hardwarowy układ wielobajtowego mnożenia i dzielenia oraz wprowadzono aż 8 wskaźników DPTR (ang. Data Pointer). W tym miejscu należy wyjaśnić, że wskaźnik ten służy do adresowania danych w zewnętrznej pamięci RAM. We wszystkich procesorach oprócz w/w wskaźnik ten jest tylko jeden i obróbka danych zawartych w zewnętrznej pamięci RAM jest bardzo utrudniona. Niedogodność ta została w tym procesorze usunięta przez wprowadzenie ośmiu wskaźników DPTR. W danej chwili aktywny jest jednak dalej jeden wskaźnik a przełączanie między nimi dokonuje się przez maskowanie odpowiednich bitów w specjalnym rejestrze 8-bitowym. Ułatwia to znacznie obróbkę danych zawartych w zewnętrznej pamięci RAM. 6

7 2.Opis budowy i działania. 2.1.Architektura. Rys.1 Schemat blokowy mikrokomputera 8051 W przedstawionym na rys.1 schemacie blokowym obrazującym wnętrze mikroprocesora 8051 można wyróżnić następujące ważniejsze układy bądź pojedyncze rejestry istotne dla użytkownika: ALU- (ang. Arithmetic Logic Unit)-jednostka arytmetyczno logiczna PSW- (ang. Program Status Word)-rejestr statusowy ACC- (ang. Accumulator)-podstawowy rejestr procesora współpracujący z ALU B-rejestr pomocniczy używany przy mnożeniu i dzieleniu ROM-pamięć programu RAM-pamięć danych 7

8 PC-(ang. Program Counter) -licznik programu adresujący pamięć programu DPTR-(ang. Data Pointer) -wskaźnik danych adresujący zewnętrzną pamięć RAM SP-(ang. Stack Pointer) -wskaźnik stosu TH0, TL0- licznik nr 0 (T-Timer, H-High, L-Low) TH1, TL1- licznik nr 1 TMOD- rejestr trybu pracy liczników nr 0 i nr 1 TCON- rejestr sterujący liczników nr 0 i nr 1 SBUF- rejestr nadajnika / odbiornika portu szeregowego SCON- rejestr sterujący portem szeregowym PCON- rejestr sterujący stanami uśpienia (ang. Power Down Mode) IE- rejestr maski przerwań (IE - ang. Interrupt Enable) IP- rejestr priorytetów przerwañ (IP - ang. Interrupt Priority) P0...P3- porty I / O (ang. Input / Output Ports) Oprócz w/w układów w procesorze 8051 występuje szereg układów bądź rejestrów pomocniczych, o których użytkownik nie musi wiedzieć i dlatego nie zostały one wyodrębnione w w/w opisie. Sygnały WE - WY pochodzą z czterech portów 8-bitowych (P0...P3) ale oprócz tych sygnałów występują jeszcze cztery istotne sygnały sterujące. PSEN -(ang. Program Store Enable) sygnał odczytu danych z zewnętrznej pamięci programu ALE - (ang. Address Latch Enable) sygnał służący do zatrzaśnięcia w zewnętrznym rejestrze LATCH młodszej części adresowej wyprowadzanej przez port P0 przy współpracy z pamięciami zewnętrznymi: EPROM i RAM EA - (ang. External Access) sygnał wyboru pamięci programu; gdy sygnał ten jest zerem wtedy program odczytywany jest z zewnętrznej pamięci programu (EPROM), a gdy jedynką - z pamięci wewnętrznej (a poza jej obszarem adresowym także z pamięci zewnętrznej) RST - (ang. Reset) sygnał zerujący mikroprocesor (patrz p.2.10) powodujący przede wszystkim wyzerowanie licznika programu PC i w związku z tym start programu od zerowej komórki pamięci EPROM. Pamięć RAM nie jest zerowana. Procesor zasilany jest pojedynczym napięciem +5V. Pobór prądu wynosi 160mA dla procesorów NMOS, 125 ma dla HMOS, 24mA dla procesorów CHMOS (przy fxtal=12mhz). Procesor przystosowany jest do przyłączenia z zewnątrz oscylatora kwarcowego (lub ceramicznego) o częstotliwości MHz, przy czym standardowo stosuje się kwarc 12MHz. 8

9 Rys.2 Opis wyprowadzeń procesora 8031 Na rys.2 zestawiono wszystkie sygnały WE - WY procesora Jak widać, sygnały WE -WY niektórych portów mogą pełnić funkcje alternatywne. Jeżeli procesor pracuje z wewnętrzną pamięcią ROM (8051) i nie korzysta z układu transmisji szeregowej, wówczas wszystkie cztery porty (P0...P3) mogą być wykorzystane jako linie wejściowe lub wyjściowe, przy czym wejścia i wyjścia mogą być dowolnie między sobą przemieszane, np. P1.0 może być wejściem a P1.2 wyjściem itp. Jeżeli procesor współpracuje z pamięciami zewnętrznymi EPROM lub RAM, wtedy port P0 pełni rolę portu danych D7...0 i młodszej części adresowej A Starsza część adresu wysyłana jest przez port P2. Wynika stąd, że port P0 musi być portem dwukierunkowym oraz to, że dane i adresy muszą być wysyłane w różnych chwilach czasowych. Przy wyprowadzaniu młodszej części adresowej generowany jest sygnał ALE służący do zatrzaśnięcia tego adresu w rejestrze zewnętrznym (np. LS373). Do adresowania pamięci zewnętrznych EPROM i RAM używa się więc adresu, którego młodszy bajt pochodzi z w/w rejestru, a starszy z portu P2. W procesorach rodziny MCS-51 nie przewidziano specjalnej przestrzeni adresowej ani instrukcji do adresowania zewnętrznych układów WE - WY. 9

10 Jeżeli zamierza się stosować takie układy, to należy je tak adresować, jak gdyby to były komórki zewnętrznej pamięci RAM i do ich obsługi używać instrukcji MOVX służących do komunikacji procesora z zewnętrzną pamięcią RAM. Wszystkie linie WE - WY portu P3 mogą spełniać funkcje alternatywne. Jeżeli korzysta się z układu transmisji szeregowej, to dla trybów pracy 1, 2, 3 tego układu linia P3.0 jest wykorzystywana dla danych odbieranych RxD (ang. Receiving of Data) a P3.1 dla danych nadawanych TxD (ang. Transmitting of Data). Przy pracy układu transmisji szeregowej w trybie 0 linią P3.0 przekazywane są dane (nadawane lub odbierane) a linią P3.1 wysyłany jest sygnał zegarowy. Linie P3.2 i P3.3 mogą być wykorzystane jako wejścia sygnałów przerwań zewnętrznych odpowiednio: INT0 i INT1. Jeżeli wykorzystuje się liczniki nr 0 i nr 1, to wejścia te można użyć do bramkowania impulsów zliczanych przez te liczniki. Wejścia P3.4 i P3.5 można wykorzystać do doprowadzenia impulsów zewnętrznych do w/w liczników, przy czym T0 dotyczy licznika nr 0 a T1-licznika nr 1. Na liniach P3.6 i P3.7 generowane są sygnały zapisu WR (ang. Write) i odczytu RD (ang. Read) przy współpracy z zewnętrzną pamięcią RAM, tzn. przy wykonywaniu instrukcji MOVX. W przypadku procesora 8032 dodatkowo przewidziano 2 linie portu P1 do obsługi licznika nr 2 a mianowicie linią P1.0 oznaczoną jako T2 można doprowadzić impulsy zliczane przez licznik nr 2 a linią P1.1- sygnał T2EX wykorzystywany w pewnych trybach pracy licznika nr 2 lub służący jako trzecie źródło zgłoszenia przerwania zewnętrznego. Jak wynika z rys.2, w przypadku współpracy procesora z pamięciami zewnętrznymi oraz przy wykorzystaniu funkcji alternatywnych portu P3 i części portu P1 do dyspozycji użytkownika może pozostać zaledwie 6 linii WE -WY portu P1. Jeżeli okaże się to niewystarczające, to można zastosować dodatkowe, zewnętrzne porty I / O umieszczając je w przestrzeni adresowej zewnętrznej pamięci RAM. Jako porty wejściowe najczęściej wykorzystuje się układy LS244, LS245, LS640 a jako porty wyjściowe stosowane są rejestry LS373, LS273, LS Przestrzeń adresowa pamięci ROM, RAM, SFR. W procesorach rodziny MCS-51 zastosowano specjalną architekturę (Harvard University Structure) polegającą na rozdzieleniu przestrzeni adresowej pamięci programu i pamięci danych. W wyniku tego można stosować pamięć programu 10

11 o pojemności max - 64kBajty i zewnętrzną pamięć danych o pojemności także do 64kBajtów. Oprócz tego w procesorze przewidziano 256-bajtową przestrzeń adresową wewnętrznej pamięci danych. Ta przestrzeń wewnętrzna dzieli się na dwa obszary. Obszar o adresach zajmuje pamięć RAM, a obszar o adresach zajmują tzw. rejestry specjalne SFR (ang. Specjal Function Registers). Rejestry SFR są to właśnie te rejestry, które wymieniono w p.2.1 a więc np. : PSW, ACC, TMOD, TCON itd. (rys.1). W procesorach 8xx2 istnieje dodatkowe 128 bajtów pamięci RAM, która zajmuje ten sam obszar ( ), który przewidziano dla rejestrów SFR. Problem ewentualnego konfliktu powstającego przy odwołaniu się do tego samego adresu rozwiązano w ten sposób, że rejestry SFR adresowane są bezpośrednio (tzn. z podaniem adresu komórki w instrukcji) a komórki pamięci ( ) można adresować tylko w sposób pośredni poprzez rejestry R0, R1; np. adres komórki umieszcza się w rejestrze R0 a następnie w celu odczytania danej do akumulatora wykonuje się instrukcję MOV - zostanie to omówione dokładniej w punkcie dotyczącym sposobów adresowania pamięci. Rys.3 Przestrzeń adresowa pamięci ROM, RAM, SFR Jak już wspomniano, zewnętrzna pamięć RAM (łącznie z ewentualnymi zewnętrznymi portami I / O może zajmować obszar 64kBajtów i niezależnie od tego można korzystać z wewnętrznej pamięci RAM. Nie zachodzi tu również kolizja przy 11

12 odwoływaniu się do adresu początkowego ( o adresach ) tych pamięci gdyż dla każdej z nich przewidziano inny zestaw instrukcji. Jeżeli chodzi o pamięć programu, to łączna jej pojemność (wewnętrznej i zewnętrznej) nie może przekraczać 64 kbajtów. Jeżeli sygnał wyboru pamięci zewnętrznej EA jest jedynką (EA=1), to do zakresu odczytywana jest pamięć wewnętrzna ROM (lub EPROM np. w 8751) a powyżej tego zakresu - zewnętrzna pamięć EPROM. Jeśliby na przykład zastosowano zewnętrzną pamięć EPROM typu 27C512 o pojemności 64kB to pierwsze cztery kilobajty tej pamięci byłyby "przysłonięte" przez pamięć wewnętrzną ROM. Zazwyczaj jednak w przypadku zastosowania zewnętrznej pamięci EPROM daje się sygnał EA=0 i wtedy komórki tej pamięci będą mieć adresy rozpoczynające się od zera (0000H) 2.3. Rejestry podstawowe procesora Do rejestrów podstawowych zalicza się: ACC- akumulator PSW-rejestr statusowy PC- licznik programu SP- wskaźnik stosu Akumulator ACC jest rejestrem podstawowym w tym sensie, że wyniki prawie wszystkich operacji arytmetycznych i logicznych gromadzone są właśnie w tym rejestrze. Ponadto instrukcje skoków warunkowych typu JZ (ang. Jump if Zero-skocz jeśli zero) lub JNZ (Jump if Non Zero - skocz jeśli nie zero) wykonywane są na podstawie badania zerowej lub niezerowej zawartości akumulatora. Rys.4 Słowo stanu procesora Rejestr PSW jest rejestrem przechowującym słowo stanu procesora (rys.4.). Słowo to zawiera tzw. znaczniki zwane także flagami. Znaczenie tych flag jest następujące: 12

13 C - (ang. Carry) znacznik przeniesienia z pozycji bitu nr 7 akumulatora. Znacznik ten ustawiany jest na 1 np. przy dodawaniu dwóch liczb binarnych, których suma nie mieści się na pozycji 8 bitów (przykład: 8CH + 94H = 120H ) lub przy odejmowaniu liczby większej od mniejszej ( np. 2-3 daje wynik FF oraz C=1). AC - (ang. Auxiliary Carry) znacznik przeniesienia połówkowego tzn. występującego z bitu nr 3 do bitu nr 4. Znacznik ten wykorzystywany jest do korekcji dziesiętnej (za pomocą instrukcji DAA) liczb przedstawionych w postaci BCD (ang. Binary Coded Decimal) a sumowanych przy wykorzystaniu normalnego sumatora binarnego. F0 - znacznik softwarowy ogólnego przeznaczenia (pozostałość po rodzinie MCS-48) RS1, RS0 - dwa bity służące do wyboru zestawu rejestrów roboczych (ang. Bank Registers): 00 -Bank nr 0 ; (00H...07H $= R0...R7) 01 -Bank nr 1 ; (08H...0fH $= R0...R7) 10 -Bank nr 2 ; (10H...17H $= R0...R7) 11 -Bank nr 3 ; (18H...1FH $= R0...R7) W danej chwili aktywny jest jeden z zestawów rejestrów, przy czym każdy zestaw zawiera osiem rejestrów oznaczonych jako : R0...R7 (rys.5). OV - (ang. Overflow) - znacznik nadmiaru wykorzystywany przy dodawaniu liczb przedstawionych w kodzie dopełnienia dwójkowego D2. P - (ang. Parity ) - znacznik parzystości ustawiany na 1 przy parzystej liczbie jedynek w akumulatorze i zerowany w sytuacji przeciwnej. Licznik programu PC (zwany także licznikiem instrukcji lub licznikiem rozkazów) adresuje pamięć programu. Jego wartość początkowa wynosi 0000H a największa możliwa FFFFH. Po wykonaniu każdego kolejnego rozkazu zawartość tego licznika jest powiększana o 1, 2 lub 3 w zależności od tego ile bajtów liczy instrukcja. Przy wykonywaniu instrukcji skoków LJMP lub wywoływania podprogramów LCALL jego wartość ładowana jest odpowiednio adresem skoku lub adresem wywołania podprogramu podanym w drugim i trzecim bajcie instrukcji. 13

14 Rys.5 Organizacja pamięci RAM. Wskaźnik stosu SP (8-bitowy) adresuje położenie wierzchołka stosu w wewnętrznej pamięci RAM. Stos jest pewnym obszarem pamięci, do którego zapisywanie i pobieranie danych podlega tym samym regułom, co układanie i pobieranie talerzy ze stosu. Do operacji na stosie służą dwie instrukcje: PUSH (umieść na stosie) i POP (pobierz ze stosu). Dane zawsze umieszcza się na wierzchołku stosu jak również z wierzchołka się je pobiera. Adres wierzchołka zawarty jest we wskaźniku SP, który zwiększa się automatycznie przy operacjach PUSH i zmniejsza przy operacjach POP, a więc programista nie musi martwić się o adres, gdzie są umieszczane lub skąd są pobierane dane. Obowiązuje przy tym generalna zasada, że operacji POP powinno być tyle, ile wykonano operacji PUSH. Ze stosu korzystają także instrukcje CALL i RET. Początkowa wartość SP po sygnale RESET wynosi 07H i może być zmieniana pod kontrolą programu na dowolną wartość z zakresu adresowego pamięci RAM. W procesorze 8xx2 może to być także 14

15 obszar 80H...FFH. W procesorach rodziny 8051 stos rośnie w kierunku rosnących adresów np. jeśli SP=60H, DPTR=1234H, to sekwencja instrukcji: PUSH DPH PUSH DPL spowoduje umieszczenie liczby 12H pod adresem 61H, liczby 34H pod adresem 62H. Wskaźnik stosu adresuje ostatnio umieszczoną na stosie daną. Stos wykorzystywany jest do ochrony rejestrów przy wywoływaniu podprogramów oraz do automatycznego zapamiętywania zawartości licznika rozkazów przy wywoływaniu podprogramów i przy wejściach w procedury obsługi przerwań. 2.4 Pamięć RAM Wewnętrzna pamięć RAM w procesorze 8051 zawiera 128 bajtów o adresach dziesiętnie lub FH w zapisie heksadecymalnym. Pierwsze 32 bajty (00...1FH ) podzielono na cztery zestawy rejestrów roboczych (ang. Bank Registers ). Każdy zestaw zawiera osiem rejestrów oznaczonych odpowiednio R0...R7. W zestawie pierwszym rejestrami R0...R7 są komórki pamięci o adresach , w drugim zestawie rejestrom tym odpowiadają komórki o adresach FH itd. Sens takiego przyporządkowania wynika stąd, że istnieje grupa instrukcji, która operuje na symbolach R0...R7 - nie ma więc potrzeby podawania adresu komórki pamięci. W danej chwili aktywny jest tylko jeden zestaw rejestrów a mianowicie ten, którego numer umieszczono na pozycji bitów RS1, RS0 w rejestrze PSW (rys.4). Korzystanie z kilku zestawów rejestrów ma sens przede wszystkim wtedy, gdy w procesorze wykorzystuje się przerwania; wtedy np. program główny korzysta z zestawu nr 0, procedura obsługi przerwania zewnętrznego INT0 z zestawu nr 1 a procedura obsługi przerwania od licznika nr 0 z zestawu nr 2. Oczywiście na początku tych procedur powinno nastąpić zapamiętanie na stosie rejestru PSW, przełączenie bitów RS1, RS0 na odpowiedni zestaw rejestrów a na końcu procedury obsługi przerwania ze stosu pobierana jest poprzednia wartość PSW i po instrukcji powrotu z przerwania RETI następuje powrót do programu głównego ze "starym " zestawem rejestrów. Jeżeli z jakiegoś zestawu nie korzysta się, to odpowiadające mu komórki pamięci można wykorzystać jako zwykłe komórki robocze adresując je bezpośrednio tzn. podając w instrukcji ich adresy. Szesnaście komórek o adresach 20H...2FH przeznaczonych jest do celów specjalnych. W tych szesnastu komórkach ponumerowano poszczególne bity w sposób pokazany na rys. 5 uzyskując zestaw 128 indywidualnych bitów o numerach FH. Otóż istnieje specjalny zestaw instrukcji przeznaczony do tzw. operacji boolowskich na 15

16 pojedynczych bitach z w/w obszaru. Instrukcje te umożliwiają indywidualne ustawianie i kasowanie pojedynczych bitów jak również istnieją instrukcje wykorzystujące rozgałęzienia w programie (skoki warunkowe) w zależności od wartości logicznej w/w bitów. Mówi się czasem, że procesor 8051 zawiera wewnątrz wbudowany procesor boolowski umożliwiający operacje na poszczególnych bitach wybranych komórek pamięci i niektórych rejestrów SFR. Bity te przy pisaniu programów grają rolę tzw. znaczników programowych umożliwiających podejmowanie decyzji odnośnie rozgałęzień programowych. Są szczególnie przydatne przy projektowaniu układów sterowania. Jeżeli nie wszystkie znaczniki są wykorzystywane w programie, to pozostałe wolne komórki mogą być wykorzystane jako zwykłe komórki robocze pamięci RAM. Pomimo, że adresy komórek bitowych i normalnych komórek bajtowych pokrywają się (są to liczby z zakresu FH), to program i tak będzie jednoznaczny, gdyż innego rodzaju instrukcje stosuje się do operacji bajtowych a innego do operacji bitowych. Na przykład instrukcja MOV 20H,#0 powoduje wyzerowanie wszystkich bitów komórki bajtowej o adresie 20H a instrukcja CLR 20H powoduje wyzerowanie bitu nr 20H czyli bitu nr.0 w komórce o adresie 24H. W procesorach 8xx2 występuje dodatkowy obszar 128 komórek pamięci o adresach 80H...FFH pokrywających się z obszarem adresowym rejestrów SFR o czym wspomniano już wcześniej. Tych komórek pamięci nie można adresować bezpośrednio (podając w instrukcji ich adresy) lecz pośrednio za pomocą rejestrów R0 i R1, np. aby zapisać wartość 3AH do komórki o adresie 82H nie można użyć instrukcji: MOV 82H,#3AH, lecz należy użyć sekwencji instrukcji : MOV R0,#82H 2.5. Rejestry SFR Rejestry specjalnego przeznaczenia SFR (ang. Special Function Registers) leżą w obszarze adresowym pamięci wewnętrznej RAM z zakresu: 80H...FFH (rys.6). Niektóre spośród tych rejestrów (np.acc, PSW, PC, SP) omówiono już w p.2.3, zaś inne, związane z obsługą liczników i układu transmisji szeregowej, zostaną omówione dalej. Zestawienie ich na wspólnym rysunku ma taki sens, że pokazuje, iż nie cała przestrzeń adresowa jest wypełniona oraz to, że niektóre spośród nich mają możliwość adresowania bitowego. Dla tych, które posiadają taką możliwość, 16

17 w odpowiednich "kratkach" bitowych podano adresy bitowe. Jak widać, w niektórych rejestrach bitom tym nadano specjalne nazwy. Są to nazwy zastrzeżone dla programu MSB LSB B F7 F6 F5 F4 F3 F2 F1 F0 F0 Rejestr B ACC E7 E6 E5 E4 E3 E2 E1 E0 E0 Akumulator PSW C AC F0 RS1 RS0 OV - P Słowo stanu procesora D7 D6 D5 D4 D3 D2 D1 D0 D0 TH2 * CD liczn.2-starszy bajt TL2 * CC liczn.2-młodszy bajt RCAP2H * CB Rej.pomocn.liczn.2-starszy bajt RCAP2L * CA Rej.pomocn.liczn.2-młodszy bajt T2CON * TF2 EXF2 RCLK TCLK EXEN2 TR2 C/ T2 CP/ RL2 CF CE CD CC CB CA C9 C8 C8 Rejestr sterujący licznika nr 2 IP - - PT2 PS PT1 PX1 PT0 PX0 Rejestr priorytetów przerwań BF BE BD BC BB BA B9 B8 B8 P3 B7 B6 B5 B4 B3 B2 B1 B0 B0 Port P3 IE EA - ET2 ES ET1 EX1 ET0 EX0 Maska przerwań AF AE AD AC AB AA A9 A8 A8 P2 A7 A6 A5 A4 A3 A2 A1 A0 A0 Port P2 SBUF 99H Rejestr nadajnika/odbiornika SCON SM0 SM1 SM2 REN TB8 RB8 TI RI 9F 9E 9D 9C 9B 9A H Rejestr ster. ukł. tr. szeregowej P H Port P1 TH1 8DH liczn.1-starszy bajt TH0 8CH liczn.0-starszy bajt TL1 8BH liczn.1-młodszy bajt TL0 8AH liczn.0-młodszy bajt TMOD 89H Rejestr trybu pracy liczn. 0 i 1 TCON TF1 TR1 TF0 TR0 IE1 IT1 IE0 IT0 8F 8E 8D 8C 8B 8A H Rejestr sterujący liczników 0 i 1 PCON SMOD x x x GF1 GF0 PD IDL 87H Rejestr stanów uśpienia ** DPH 83H Rejestr DPTR-starszy bajt DPL 82H Rejestr DPTR- młodszy bajt SP 81H Wskaźnik stosu P H Port P0 *) dotyczy tylko 8xx2 **) w procesorach HMOS czynny jest tylko SMOD, w CHMOS - wszystkie Rys.6 Zestawienie rejestrów SFR 17

18 asemblera i nie można ich używać do innych celów np. jako nazw etykiet przy pisaniu programu. Na przykład w celu wyzerowania bitu nr 1 w rejestrze IP można użyć instrukcji: CLR 0B9H lub CLR PT0 lub też : CLR IP Porty P0...P3 Jak wynika z rys.2, prawie wszystkie porty I/O mogą pełnić funkcje alternatywne, stąd też struktura każdego z portów jest nieco odmienna. Jeśli nie korzysta się z pamięci zewnętrznej, z przerwań i z transmisji szeregowej, wtedy każda linia każdego portu może być wykorzystana albo jako wejście, albo jako wyjście. Jeżeli jednak korzysta się z funkcji alternatywnych, wtedy dana linia nie może pełnić funkcji wejścia lub wyjścia. Na przykład przy współpracy z pamięcią zewnętrzną zajęty jest cały port P0 i część portu P2 - wtedy nie tylko linie zajęte ale również pozostałe wolne linie portu P2 nie mogą być wykorzystane do sterowania urządzeniami zewnętrznymi. Rys.7 Struktura linii portu P0 Strukturę linii portu P0 przedstawiono na rys.7. Jak widać, występuje tam przerzutnik typu D (latch) wchodzący w skład 8 - bitowego rejestru uwidocznionego na rys. 1. Przerzutnik ten poprzez multiplekser MPX steruje tranzystorem wyjściowym 18

19 T1 z którym związana jest linia P0.x, (x=0...7). Jeżeli procesor nie współpracuje z pamięcią zewnętrzną (S=0), wtedy tranzystor T2 jest wyłączony a wyjście Q przerzutnika połączone z bramką tranzystora T1. Jeżeli więc przerzutnik jest w stanie "0" (tzn.q=1), wtedy tranzystor T1 jest włączony i na wyjściu P0.x uzyskuje się sygnał "0". Jeżeli przerzutnik Q jest w stanie "1" (tzn. Q=0), wtedy tranzystor T1 jest zablokowany i na wyjściu P0.x potencjał jest nieokreślony. Aby uzyskać sygnał logiczny "1" należy wyjście P0.x przyłączyć przez opornik (np.30kω) do napięcia +Vc. Jest to tzw. opornik "Pull - Up" i jego zastosowanie jest niezbędne wtedy, gdy port P0 wykorzystuje się jako port wejściowo - wyjściowy. Wejście D przerzutnika przyłączone jest do odpowiedniej linii wewnętrznej szyny danych i procesor zapisuje informację binarną do tego przerzutnika generując odpowiedni sygnał zapisu na wejściu C przerzutnika. Odczytywanie stanu portu odbywać się może dwojako w zależności od typu instrukcji: albo odczytuje się stan przerzutnika przez bramkę 3-stanową BT1 albo bezpośrednio stan linii P0.x przez bramkę BT2. Istnieje pewna grupa instrukcji zwanych RWM (ang. Read - Write - Modify), w których odczytywany jest i modyfikowany stan portu. W instrukcjach tych odczyt linii I/O następuje przez bramkę BT1. Przykładem instrukcji RWM mogą być: ANL P0,#7FH -odczytaj port P0, wyzeruj bit nr 7 i zapisz wynik ponownie do portu P0. CLR P0.3 -wyzeruj bit nr 3 portu P0 -odbywa się to w ten sposób, że czytany jest cały rejestr portu P0, zerowany jest bit nr 3 i wynik z powrotem zapisywany do rejestru 8- bitowego sterującego portem P0. W pozostałych instrukcjach dotyczących portów nie jest czytany stan rejestru ale bezpośrednio stan linii P0.x przez bramkę BT2. Są to np. instrukcje: MOV R1,P0 -odczytaj port P0 do rejestru R1 ANL A,P0 -wykonaj logiczne AND zawartości akumulatora z zawartością odczytaną bezpośrednio z linii zewnętrznych portu i wynik umieść w akumulatorze. Stan sygnałów P0.x może być niezgodny ze stanem przerzutnika; może to wystąpić wtedy, gdy np. bezpośrednio z końcówki P0.x steruje się bazą tranzystora bipolarnego, co powoduje znaczny spadek sygnału "1" do około 0.7V. Podobny 19

20 mechanizm odczytu przerzutników lub bezpośrednio linii WE - WY dotyczy także portów P1...P3. Wszystkie przerzutniki we wszystkich portach P0...P3 są ustawiane do stanu "1" po sygnale RESET, a więc tranzystory T1 są wtedy zablokowane i porty są ustawiane jako wejściowe. Rezystancja opornika R (w porcie P0- zewnętrzny) wynosi ok.70kω w stanie statycznym ( w stanach dynamicznych jest kilkanaście razy mniejsza co przyśpiesza przełączanie) i w związku z tym na wszystkich wyprowadzeniach występują sygnały "1". Jeżeli dana linia (dowolnego portu ) ma pracować jako wejście, to nie należy nic robić, wystarczy ją tylko odczytywać wtedy, gdy zachodzi potrzeba, ale jeżeli dana linia pełnić ma funkcję wyjścia, to zazwyczaj przyłączone jest do niej wejście wzmacniacza wykonawczego, który w takim przypadku załączyłby sterowany przez niego element wykonawczy. W tym przypadku należy bezpośrednio jako jedną z pierwszych instrukcji programu wykonać operację zerowania rozważanej linii wyjściowej. Jeżeli port P0 przeznaczony jest do współpracy z pamięcią zewnętrzną, (S=1) wtedy przez multiplekser przechodzą odpowiednie sygnały adresów lub danych (A/D) a wyjście przerzutnika Q jest odłączone. Przy A/D =1 włączony zostaje tranzystor T2 a zablokowany T1, co daje P0.x=1, natomiast przy A/D =0 tranzystor T2 zostaje wyłączony a T1- włączony, co daje sygnał P0.x=0. Wynika stąd, że do współpracy z pamięcią zewnętrzną oporniki "Pull - Up" nie są potrzebne. Rys.8 Struktura linii portu P1 20

MIKROPROCESORY architektura i programowanie

MIKROPROCESORY architektura i programowanie Systematyczny przegląd. (CISC) SFR umieszczane są w wewnętrznej pamięci danych (80H 0FFH). Adresowanie wyłącznie bezpośrednie. Rejestry o adresach podzielnych przez 8 są też dostępne bitowo. Adres n-tego

Bardziej szczegółowo

CYKL ROZKAZOWY = 1 lub 2(4) cykle maszynowe

CYKL ROZKAZOWY = 1 lub 2(4) cykle maszynowe MIKROKONTROLER RODZINY MCS 5 Cykl rozkazowy mikrokontrolera rodziny MCS 5 Mikroprocesory rodziny MCS 5 zawierają wewnętrzny generator sygnałów zegarowych ustalający czas trwania cyklu zegarowego Częstotliwość

Bardziej szczegółowo

MIKROPROCESORY architektura i programowanie

MIKROPROCESORY architektura i programowanie Struktura portów (CISC) Port to grupa (zwykle 8) linii wejścia/wyjścia mikrokontrolera o podobnych cechach i funkcjach Większość linii we/wy może pełnić dwie lub trzy rozmaite funkcje. Struktura portu

Bardziej szczegółowo

Ćwiczenie 9 Częstościomierz oparty na µc 8051(8052)

Ćwiczenie 9 Częstościomierz oparty na µc 8051(8052) Laboratorium Techniki Mikroprocesorowej Informatyka studia dzienne Ćwiczenie 9 Częstościomierz oparty na µc 8051(8052) Cel ćwiczenia Celem ćwiczenia jest zapoznanie się z możliwościami zastosowania mikrokontrolerów

Bardziej szczegółowo

3.2. Zegar/kalendarz z pamięcią statyczną RAM 256 x 8

3.2. Zegar/kalendarz z pamięcią statyczną RAM 256 x 8 3.2. Zegar/kalendarz z pamięcią statyczną RAM 256 x 8 Układ PCF 8583 jest pobierającą małą moc, 2048 bitową statyczną pamięcią CMOS RAM o organizacji 256 x 8 bitów. Adresy i dane są przesyłane szeregowo

Bardziej szczegółowo

Systemy wbudowane. Wprowadzenie. Wprowadzenie. Mikrokontroler 8051 Budowa

Systemy wbudowane. Wprowadzenie. Wprowadzenie. Mikrokontroler 8051 Budowa Systemy wbudowane Mikrokontroler 8051 Budowa dr inż. Maciej Piechowiak Wprowadzenie rdzeń CPU z jednostką artymetyczno-logiczną (ALU) do obliczeń na liczbach 8-bitowych, uniwersalne dwukierunkowe porty

Bardziej szczegółowo

4 Transmisja szeregowa na przykładzie komunikacji dwukierunkowej z komputerem PC, obsługa wyświetlacza LCD.

4 Transmisja szeregowa na przykładzie komunikacji dwukierunkowej z komputerem PC, obsługa wyświetlacza LCD. 13 4 Transmisja szeregowa na przykładzie komunikacji dwukierunkowej z komputerem PC, obsługa wyświetlacza LCD. Zagadnienia do przygotowania: - budowa i działanie interfejsu szeregowego UART, - tryby pracy,

Bardziej szczegółowo

ad a) Konfiguracja licznika T1 Niech nasz program składa się z dwóch fragmentów kodu: inicjacja licznika T1 pętla główna

ad a) Konfiguracja licznika T1 Niech nasz program składa się z dwóch fragmentów kodu: inicjacja licznika T1 pętla główna Technika Mikroprocesorowa Laboratorium 4 Obsługa liczników i przerwań Cel ćwiczenia: Celem ćwiczenia jest nabycie umiejętności obsługi układów czasowo-licznikowych oraz obsługi przerwań. Nabyte umiejętności

Bardziej szczegółowo

Start Bity Bit Stop 1 Bit 0 1 2 3 4 5 6 7 Par. 1 2. Rys. 1

Start Bity Bit Stop 1 Bit 0 1 2 3 4 5 6 7 Par. 1 2. Rys. 1 Temat: Obsługa portu komunikacji szeregowej RS232 w systemie STRC51. Ćwiczenie 2. (sd) 1.Wprowadzenie do komunikacji szeregowej RS232 Systemy bazujące na procesorach C51 mogą komunikować się za pomocą

Bardziej szczegółowo

Informacje ogólne o układzie 8051.

Informacje ogólne o układzie 8051. Informacje ogólne o układzie 8051. Układ 8051 jest jednoukładowym mikrokontrolerem 8-bitowym. Mikrokontroler jest umieszczony w 40-nóŜkowej obudowie typu DIL. Poszczególne końcówki układu mają następujące

Bardziej szczegółowo

TECHNIKA MIKROPROCESOROWA

TECHNIKA MIKROPROCESOROWA LABORATORIUM TECHNIKA MIKROPROCESOROWA Port transmisji szeregowej USART MCS'51 Opracował: Tomasz Miłosławski 1. Cel ćwiczenia Celem ćwiczenia jest zapoznanie się ze sposobami komunikacji mikrokontrolera

Bardziej szczegółowo

Praktyka Techniki Mikroprocesorowej. Mikrokontroler ADuC834

Praktyka Techniki Mikroprocesorowej. Mikrokontroler ADuC834 Praktyka Techniki Mikroprocesorowej Elżbieta Ślubowska Mikrokontroler ADuC834 Materiały pomocnicze do II części zajęć laboratoryjnych. Warszawa 2006 1.Spis treści 1. SPIS TREŚCI...2 2. OPIS STANOWISKA....4

Bardziej szczegółowo

2. PORTY WEJŚCIA/WYJŚCIA (I/O)

2. PORTY WEJŚCIA/WYJŚCIA (I/O) 2. PORTY WEJŚCIA/WYJŚCIA (I/O) 2.1 WPROWADZENIE Porty I/O mogą pracować w kilku trybach: - przesyłanie cyfrowych danych wejściowych i wyjściowych a także dla wybrane wyprowadzenia: - generacja przerwania

Bardziej szczegółowo

organizacja procesora 8086

organizacja procesora 8086 Systemy komputerowe Procesor 8086 - tendencji w organizacji procesora organizacja procesora 8086 " # $ " % strali " & ' ' ' ( )" % *"towego + ", -" danych. Magistrala adresowa jest 20.bitowa, co pozwala

Bardziej szczegółowo

Przerwania w architekturze mikrokontrolera X51

Przerwania w architekturze mikrokontrolera X51 Przerwania w architekturze mikrokontrolera X51 (przykład przerwanie zegarowe) Ryszard J. Barczyński, 2009 Politechnika Gdańska, Wydział FTiMS, Katedra Fizyki Ciała Stałego Materiały dydaktyczne do użytku

Bardziej szczegółowo

Wstęp...9. 1. Architektura... 13

Wstęp...9. 1. Architektura... 13 Spis treści 3 Wstęp...9 1. Architektura... 13 1.1. Schemat blokowy...14 1.2. Pamięć programu...15 1.3. Cykl maszynowy...16 1.4. Licznik rozkazów...17 1.5. Stos...18 1.6. Modyfikowanie i odtwarzanie zawartości

Bardziej szczegółowo

Mikrokontroler ATmega32. System przerwań Porty wejścia-wyjścia Układy czasowo-licznikowe

Mikrokontroler ATmega32. System przerwań Porty wejścia-wyjścia Układy czasowo-licznikowe Mikrokontroler ATmega32 System przerwań Porty wejścia-wyjścia Układy czasowo-licznikowe 1 Przerwanie Przerwanie jest inicjowane przez urządzenie zewnętrzne względem mikroprocesora, zgłaszające potrzebę

Bardziej szczegółowo

UTK Można stwierdzić, że wszystkie działania i operacje zachodzące w systemie są sterowane bądź inicjowane przez mikroprocesor.

UTK Można stwierdzić, że wszystkie działania i operacje zachodzące w systemie są sterowane bądź inicjowane przez mikroprocesor. Zadaniem centralnej jednostki przetwarzającej CPU (ang. Central Processing Unit), oprócz przetwarzania informacji jest sterowanie pracą pozostałych układów systemu. W skład CPU wchodzą mikroprocesor oraz

Bardziej szczegółowo

Temat: Pamięci. Programowalne struktury logiczne.

Temat: Pamięci. Programowalne struktury logiczne. Temat: Pamięci. Programowalne struktury logiczne. 1. Pamięci są układami służącymi do przechowywania informacji w postaci ciągu słów bitowych. Wykonuje się jako układy o bardzo dużym stopniu scalenia w

Bardziej szczegółowo

Metody obsługi zdarzeń

Metody obsługi zdarzeń SWB - Przerwania, polling, timery - wykład 10 asz 1 Metody obsługi zdarzeń Przerwanie (ang. Interrupt) - zmiana sterowania, niezależnie od aktualnie wykonywanego programu, spowodowana pojawieniem się sygnału

Bardziej szczegółowo

Architektura komputerów

Architektura komputerów Architektura komputerów Wykład 3 Jan Kazimirski 1 Podstawowe elementy komputera. Procesor (CPU) 2 Plan wykładu Podstawowe komponenty komputera Procesor CPU Cykl rozkazowy Typy instrukcji Stos Tryby adresowania

Bardziej szczegółowo

LICZNIKI Liczniki scalone serii 749x

LICZNIKI Liczniki scalone serii 749x LABOATOIUM PODSTAWY ELEKTONIKI LICZNIKI Liczniki scalone serii 749x Cel ćwiczenia Zapoznanie się z budową i zasadą działania liczników synchronicznych i asynchronicznych. Poznanie liczników dodających

Bardziej szczegółowo

Mikrokontroler Intel 8051. dr inż. Wiesław Madej

Mikrokontroler Intel 8051. dr inż. Wiesław Madej Mikrokontroler Intel 8051 dr inż. Wiesław Madej Mikrokontroler Intel 8051 Wprowadzony na rynek w 1980 roku Następca rodziny 8048 Intel zakooczył produkcję w marcu 2006 Obecnie produkowany przez różne firmy

Bardziej szczegółowo

Ćwiczenie 2 Transmisja a szeregowa µc 8051(8052) - PC

Ćwiczenie 2 Transmisja a szeregowa µc 8051(8052) - PC Laboratorium Techniki Mikroprocesorowej Informatyka studia dzienne Ćwiczenie 2 Transmisja a szeregowa µc 8051(8052) - PC Cel ćwiczenia Celem ćwiczenia jest zapoznanie się z budową i programowaniem implementacji

Bardziej szczegółowo

PC 3 PC^ TIMER IN RESET PC5 TIMER OUT. c 3. L 5 c.* Cl* 10/H CE RO WR ALE ADO AD1 AD2 AD3 AD4 A05 A06 LTJ CO H 17 AD7 U C-"

PC 3 PC^ TIMER IN RESET PC5 TIMER OUT. c 3. L 5 c.* Cl* 10/H CE RO WR ALE ADO AD1 AD2 AD3 AD4 A05 A06 LTJ CO H 17 AD7 U C- PC 3 PC^ TIMER IN RESET PC5 TIMER OUT 10/H CE RO WR ALE ADO AD1 AD2 AD3 AD4 A05 A06 AD7 U ss c 3 L 5 c.* Cl* S 9 10 11 12 13 U 15 H 17 Cu C-" ln LTJ CO 2.12. Wielofunkcyjne układy współpracujące z mikroprocesorem

Bardziej szczegółowo

Programowanie w językach asemblera i C

Programowanie w językach asemblera i C Programowanie w językach asemblera i C Mariusz NOWAK Programowanie w językach asemblera i C (1) 1 Dodawanie dwóch liczb - program Napisać program, który zsumuje dwie liczby. Wynik dodawania należy wysłać

Bardziej szczegółowo

Wyświetlacz alfanumeryczny LCD zbudowany na sterowniku HD44780

Wyświetlacz alfanumeryczny LCD zbudowany na sterowniku HD44780 Dane techniczne : Wyświetlacz alfanumeryczny LCD zbudowany na sterowniku HD44780 a) wielkość bufora znaków (DD RAM): 80 znaków (80 bajtów) b) możliwość sterowania (czyli podawania kodów znaków) za pomocą

Bardziej szczegółowo

Opis mikrokontrolera AT89C2051

Opis mikrokontrolera AT89C2051 Opis mikrokontrolera AT89C2051 Cechy mikrokontrolera AT89C2051: kompatybilny z układami rodziny MCS-51, 2kB wewnętrznej pamięci typu Flash-EPROM, zegar: 0Hz do 24MHz, 8-bitowa jednostka centralna, 128B

Bardziej szczegółowo

Mikrokontroler 80C51

Mikrokontroler 80C51 DSM-51 * STRONA 1 * Temat : Wiadomości podstawowe Układy cyfrowe to rodzaj układów elektronicznych, w których sygnały napięciowe przyjmują tylko określoną liczbę poziomów, którym przypisywane są wartości

Bardziej szczegółowo

dwójkę liczącą Licznikiem Podział liczników:

dwójkę liczącą Licznikiem Podział liczników: 1. Dwójka licząca Przerzutnik typu D łatwo jest przekształcić w przerzutnik typu T i zrealizować dzielnik modulo 2 - tzw. dwójkę liczącą. W tym celu wystarczy połączyć wyjście zanegowane Q z wejściem D.

Bardziej szczegółowo

Struktura i działanie jednostki centralnej

Struktura i działanie jednostki centralnej Struktura i działanie jednostki centralnej ALU Jednostka sterująca Rejestry Zadania procesora: Pobieranie rozkazów; Interpretowanie rozkazów; Pobieranie danych Przetwarzanie danych Zapisywanie danych magistrala

Bardziej szczegółowo

Przerwania, polling, timery - wykład 9

Przerwania, polling, timery - wykład 9 SWB - Przerwania, polling, timery - wykład 9 asz 1 Przerwania, polling, timery - wykład 9 Adam Szmigielski aszmigie@pjwstk.edu.pl SWB - Przerwania, polling, timery - wykład 9 asz 2 Metody obsługi zdarzeń

Bardziej szczegółowo

LICZNIKI PODZIAŁ I PARAMETRY

LICZNIKI PODZIAŁ I PARAMETRY LICZNIKI PODZIAŁ I PARAMETRY Licznik jest układem służącym do zliczania impulsów zerojedynkowych oraz zapamiętywania ich liczby. Zależnie od liczby n przerzutników wchodzących w skład licznika pojemność

Bardziej szczegółowo

Architektura komputera. Dane i rozkazy przechowywane są w tej samej pamięci umożliwiającej zapis i odczyt

Architektura komputera. Dane i rozkazy przechowywane są w tej samej pamięci umożliwiającej zapis i odczyt Architektura komputera Architektura von Neumanna: Dane i rozkazy przechowywane są w tej samej pamięci umożliwiającej zapis i odczyt Zawartośd tej pamięci jest adresowana przez wskazanie miejsca, bez względu

Bardziej szczegółowo

2. Architektura mikrokontrolerów PIC16F8x... 13

2. Architektura mikrokontrolerów PIC16F8x... 13 Spis treści 3 Spis treœci 1. Informacje wstępne... 9 2. Architektura mikrokontrolerów PIC16F8x... 13 2.1. Budowa wewnętrzna mikrokontrolerów PIC16F8x... 14 2.2. Napięcie zasilania... 17 2.3. Generator

Bardziej szczegółowo

Programowanie mikrokontrolera 8051

Programowanie mikrokontrolera 8051 Programowanie mikrokontrolera 8051 Podane poniżej informacje mogą pomóc w nauce programowania mikrokontrolerów z rodziny 8051. Opisane są tu pewne specyficzne cechy tych procesorów a także podane przykłady

Bardziej szczegółowo

Opis układów wykorzystanych w aplikacji

Opis układów wykorzystanych w aplikacji Opis układów wykorzystanych w aplikacji Układ 74LS164 jest rejestrem przesuwnym służącym do zamiany informacji szeregowej na równoległą. Układ, którego symbol logiczny pokazuje rysunek 1, posiada dwa wejścia

Bardziej szczegółowo

Wstęp do informatyki. System komputerowy. Magistrala systemowa. Architektura komputera. Cezary Bolek

Wstęp do informatyki. System komputerowy. Magistrala systemowa. Architektura komputera. Cezary Bolek Wstęp do informatyki Architektura komputera Cezary Bolek cbolek@ki.uni.lodz.pl Uniwersytet Łódzki Wydział Zarządzania Katedra Informatyki System komputerowy systemowa (System Bus) Pamięć operacyjna ROM,

Bardziej szczegółowo

Technika Mikroprocesorowa

Technika Mikroprocesorowa Technika Mikroprocesorowa Dariusz Makowski Katedra Mikroelektroniki i Technik Informatycznych tel. 631 2648 dmakow@dmcs.pl http://neo.dmcs.p.lodz.pl/tm 1 System mikroprocesorowy? (1) Magistrala adresowa

Bardziej szczegółowo

Układy czasowo-licznikowe w systemach mikroprocesorowych

Układy czasowo-licznikowe w systemach mikroprocesorowych Układy czasowo-licznikowe w systemach mikroprocesorowych 1 W każdym systemie mikroprocesorowym znajduje zastosowanie układ czasowy lub układ licznikowy Liczba liczników stosowanych w systemie i ich długość

Bardziej szczegółowo

Ćwiczenie 30. Techniki mikroprocesorowe Programowanie w języku Asembler mikrokontrolerów rodziny '51

Ćwiczenie 30. Techniki mikroprocesorowe Programowanie w języku Asembler mikrokontrolerów rodziny '51 Ćwiczenie 30 Techniki mikroprocesorowe Programowanie w języku Asembler mikrokontrolerów rodziny '51 Cel ćwiczenia Poznanie architektury oraz zasad programowania mikrokontrolerów rodziny 51, aby zapewnić

Bardziej szczegółowo

UKŁAD SCALONY. Cyfrowe układy można podzielić ze względu na różne kryteria, na przykład sposób przetwarzania informacji, technologię wykonania.

UKŁAD SCALONY. Cyfrowe układy można podzielić ze względu na różne kryteria, na przykład sposób przetwarzania informacji, technologię wykonania. UKŁDAY CYFROWE Układy cyfrowe są w praktyce realizowane różnymi technikami. W prostych urządzeniach automatyki powszechnie stosowane są układy elektryczne, wykorzystujące przekaźniki jako podstawowe elementy

Bardziej szczegółowo

Architektura Systemów Komputerowych. Jednostka ALU Przestrzeń adresowa Tryby adresowania

Architektura Systemów Komputerowych. Jednostka ALU Przestrzeń adresowa Tryby adresowania Architektura Systemów Komputerowych Jednostka ALU Przestrzeń adresowa Tryby adresowania 1 Jednostka arytmetyczno- logiczna ALU ALU ang: Arythmetic Logic Unit Argument A Argument B A B Ci Bit przeniesienia

Bardziej szczegółowo

Podstawy działania układów cyfrowych...2 Systemy liczbowe...2 Kodowanie informacji...3 Informacja cyfrowa...4 Bramki logiczne...

Podstawy działania układów cyfrowych...2 Systemy liczbowe...2 Kodowanie informacji...3 Informacja cyfrowa...4 Bramki logiczne... Podstawy działania układów cyfrowych...2 Systemy liczbowe...2 Kodowanie informacji...3 Informacja cyfrowa...4 Bramki logiczne...4 Podział układów logicznych...6 Cyfrowe układy funkcjonalne...8 Rejestry...8

Bardziej szczegółowo

A&Q PYTANIA I ODPOWIEDZI Z MIKROKONTROLERÓW

A&Q PYTANIA I ODPOWIEDZI Z MIKROKONTROLERÓW A&Q PYTANIA I ODPOWIEDZI Z MIKROKONTROLERÓW KŁ ZSP4 2012 Czym jest mikrokontroler? Mikrokontrolery są układami sekwencyjnymi, synchronicznymi, tzn. wszystkie operacje wykonywane przez układy procesora

Bardziej szczegółowo

ĆWICZENIE 5. TEMAT: OBSŁUGA PORTU SZEREGOWEGO W PAKIECIE KEILuVISON WYSYŁANIE PORTEM SZEREGOWYM

ĆWICZENIE 5. TEMAT: OBSŁUGA PORTU SZEREGOWEGO W PAKIECIE KEILuVISON WYSYŁANIE PORTEM SZEREGOWYM ĆWICZENIE 5 TEMAT: OBSŁUGA PORTU SZEREGOWEGO W PAKIECIE KEILuVISON WYSYŁANIE PORTEM SZEREGOWYM Wiadomości wstępne: Port szeregowy może pracować w czterech trybach. Tryby różnią się między sobą liczbą bitów

Bardziej szczegółowo

Zagadnienia zaliczeniowe z przedmiotu Układy i systemy mikroprocesorowe elektronika i telekomunikacja, stacjonarne zawodowe

Zagadnienia zaliczeniowe z przedmiotu Układy i systemy mikroprocesorowe elektronika i telekomunikacja, stacjonarne zawodowe Zagadnienia zaliczeniowe z przedmiotu Układy i systemy mikroprocesorowe elektronika i telekomunikacja, stacjonarne zawodowe System mikroprocesorowy 1. Przedstaw schemat blokowy systemu mikroprocesorowego.

Bardziej szczegółowo

ARCHITEKTURA PROCESORA,

ARCHITEKTURA PROCESORA, ARCHITEKTURA PROCESORA, poza blokami funkcjonalnymi, to przede wszystkim: a. formaty rozkazów, b. lista rozkazów, c. rejestry dostępne programowo, d. sposoby adresowania pamięci, e. sposoby współpracy

Bardziej szczegółowo

Organizacja pamięci VRAM monitora znakowego. 1. Tryb pracy automatycznej

Organizacja pamięci VRAM monitora znakowego. 1. Tryb pracy automatycznej Struktura stanowiska laboratoryjnego Na rysunku 1.1 pokazano strukturę stanowiska laboratoryjnego Z80 z interfejsem częstościomierza- czasomierz PFL 21/22. Rys.1.1. Struktura stanowiska. Interfejs częstościomierza

Bardziej szczegółowo

LEKCJA. TEMAT: Funktory logiczne.

LEKCJA. TEMAT: Funktory logiczne. TEMAT: Funktory logiczne. LEKCJA 1. Bramką logiczną (funktorem) nazywa się układ elektroniczny realizujący funkcje logiczne jednej lub wielu zmiennych. Sygnały wejściowe i wyjściowe bramki przyjmują wartość

Bardziej szczegółowo

PRZERZUTNIKI: 1. Należą do grupy bloków sekwencyjnych, 2. podstawowe układy pamiętające

PRZERZUTNIKI: 1. Należą do grupy bloków sekwencyjnych, 2. podstawowe układy pamiętające PRZERZUTNIKI: 1. Należą do grupy bloków sekwencyjnych, 2. podstawowe układy pamiętające Zapamiętywanie wartości wybranych zmiennych binarnych, jak również sekwencji tych wartości odbywa się w układach

Bardziej szczegółowo

LEKCJA TEMAT: Zasada działania komputera.

LEKCJA TEMAT: Zasada działania komputera. LEKCJA TEMAT: Zasada działania komputera. 1. Ogólna budowa komputera Rys. Ogólna budowa komputera. 2. Komputer składa się z czterech głównych składników: procesor (jednostka centralna, CPU) steruje działaniem

Bardziej szczegółowo

Projekt z przedmiotu Systemy akwizycji i przesyłania informacji. Temat pracy: Licznik binarny zliczający do 10.

Projekt z przedmiotu Systemy akwizycji i przesyłania informacji. Temat pracy: Licznik binarny zliczający do 10. Projekt z przedmiotu Systemy akwizycji i przesyłania informacji Temat pracy: Licznik binarny zliczający do 10. Andrzej Kuś Aleksander Matusz Prowadzący: dr inż. Adam Stadler Układy cyfrowe przetwarzają

Bardziej szczegółowo

Wydział Elektryczny. Katedra Automatyki i Elektroniki. Instrukcja. do ćwiczeń laboratoryjnych z przedmiotu: SYSTEMY CYFROWE 1.

Wydział Elektryczny. Katedra Automatyki i Elektroniki. Instrukcja. do ćwiczeń laboratoryjnych z przedmiotu: SYSTEMY CYFROWE 1. Politechnika Białostocka Wydział Elektryczny Katedra Automatyki i Elektroniki Instrukcja do ćwiczeń laboratoryjnych z przedmiotu: SYSTEMY CYFROWE 1 PAMIĘCI SZEREGOWE EEPROM Ćwiczenie 3 Opracował: dr inŝ.

Bardziej szczegółowo

Systemy wbudowane. Uniwersytet Łódzki Wydział Fizyki i Informatyki Stosowanej. Witold Kozłowski

Systemy wbudowane. Uniwersytet Łódzki Wydział Fizyki i Informatyki Stosowanej. Witold Kozłowski Uniwersytet Łódzki Wydział Fizyki i Informatyki Stosowanej Systemy wbudowane Witold Kozłowski Zakład Fizyki i Technologii Struktur Nanometrowych 90-236 Łódź, Pomorska 149/153 https://std2.phys.uni.lodz.pl/mikroprocesory/

Bardziej szczegółowo

Budowa i zasada działania komputera. dr Artur Bartoszewski

Budowa i zasada działania komputera. dr Artur Bartoszewski Budowa i zasada działania komputera 1 dr Artur Bartoszewski Jednostka arytmetyczno-logiczna 2 Pojęcie systemu mikroprocesorowego Układ cyfrowy: Układy cyfrowe służą do przetwarzania informacji. Do układu

Bardziej szczegółowo

WFiIS CEL ĆWICZENIA WSTĘP TEORETYCZNY

WFiIS CEL ĆWICZENIA WSTĘP TEORETYCZNY WFiIS LABORATORIUM Z ELEKTRONIKI Imię i nazwisko: 1. 2. TEMAT: ROK GRUPA ZESPÓŁ NR ĆWICZENIA Data wykonania: Data oddania: Zwrot do poprawy: Data oddania: Data zliczenia: OCENA CEL ĆWICZENIA Ćwiczenie

Bardziej szczegółowo

Lista rozkazów mikrokontrolera 8051 część pierwsza: instrukcje przesyłania danych, arytmetyczne i logiczne

Lista rozkazów mikrokontrolera 8051 część pierwsza: instrukcje przesyłania danych, arytmetyczne i logiczne Lista rozkazów mikrokontrolera 8051 część pierwsza: instrukcje przesyłania danych, arytmetyczne i logiczne Ryszard J. Barczyński, 2016 Politechnika Gdańska, Wydział FTiMS, Katedra Fizyki Ciała Stałego

Bardziej szczegółowo

Programowanie mikrokontrolerów. 8 listopada 2007

Programowanie mikrokontrolerów. 8 listopada 2007 Programowanie mikrokontrolerów Marcin Engel Marcin Peczarski 8 listopada 2007 Alfanumeryczny wyświetlacz LCD umożliwia wyświetlanie znaków ze zbioru będącego rozszerzeniem ASCII posiada zintegrowany sterownik

Bardziej szczegółowo

Mikrokontroler AVR ATmega32 - wykład 9

Mikrokontroler AVR ATmega32 - wykład 9 SWB - Mikrokontroler AVR ATmega32 - wykład 9 asz 1 Mikrokontroler AVR ATmega32 - wykład 9 Adam Szmigielski aszmigie@pjwstk.edu.pl SWB - Mikrokontroler AVR ATmega32 - wykład 9 asz 2 CechyµC ATmega32 1.

Bardziej szczegółowo

4. Karta modułu Slave

4. Karta modułu Slave sygnały na magistralę. Można wyróżnić trzy typy układów scalonych takie jak bramki o otwartym kolektorze wyjściowym, bramki trójstanowe i bramki o przeciwsobnym wzmacniaczu wyjściowym. Obciążalność prądową

Bardziej szczegółowo

BADANIE PRZERZUTNIKÓW ASTABILNEGO, MONOSTABILNEGO I BISTABILNEGO

BADANIE PRZERZUTNIKÓW ASTABILNEGO, MONOSTABILNEGO I BISTABILNEGO Ćwiczenie 11 BADANIE PRZERZUTNIKÓW ASTABILNEGO, MONOSTABILNEGO I BISTABILNEGO 11.1 Cel ćwiczenia Celem ćwiczenia jest poznanie rodzajów, budowy i właściwości przerzutników astabilnych, monostabilnych oraz

Bardziej szczegółowo

Ćw. 5. Obsługa portu szeregowego UART w mikrokontrolerach 8051.

Ćw. 5. Obsługa portu szeregowego UART w mikrokontrolerach 8051. Ćw 5 Obsługa portu szeregowego UART w mikrokontrolerach 8051 Opracowanie: mgr inż Michał Lankosz 1 Wprowadzenie Celem ćwiczenia jest poznanie działania układu transmisji szeregowej UART 2 Niezbędne wiadomości

Bardziej szczegółowo

Technika mikroprocesorowa. W. Daca, Politechnika Szczecińska, Wydział Elektryczny, 2007/08

Technika mikroprocesorowa. W. Daca, Politechnika Szczecińska, Wydział Elektryczny, 2007/08 Pamięci Układy pamięci kontaktują się z otoczeniem poprzez szynę danych, szynę owa i szynę sterującą. Szerokość szyny danych określa liczbę bitów zapamiętywanych do pamięci lub czytanych z pamięci w trakcie

Bardziej szczegółowo

f we DZIELNIKI I PODZIELNIKI CZĘSTOTLIWOŚCI Dzielnik częstotliwości: układ dający impuls na wyjściu co P impulsów na wejściu

f we DZIELNIKI I PODZIELNIKI CZĘSTOTLIWOŚCI Dzielnik częstotliwości: układ dający impuls na wyjściu co P impulsów na wejściu DZIELNIKI I PODZIELNIKI CZĘSTOTLIWOŚCI Dzielnik częstotliwości: układ dający impuls na wyjściu co P impulsów na wejściu f wy f P Podzielnik częstotliwości: układ, który na każde p impulsów na wejściu daje

Bardziej szczegółowo

SYSTEM MIKROPROCESOROWY

SYSTEM MIKROPROCESOROWY SYSTEM MIKROPROCESOROWY CPU ROM RAM I/O AB DB CB Rys 4.1. System mikroprocesorowy MIKROPROCESOR RDZEŃ MIKROPROCESORA PODSTAWOWE ZESPOŁY FUNKCJONALNE MIKROPROCESORA Mikroprocesor zawiera następujące, podstawowe

Bardziej szczegółowo

Podział układów cyfrowych. rkijanka

Podział układów cyfrowych. rkijanka Podział układów cyfrowych rkijanka W zależności od przyjętego kryterium możemy wyróżnić kilka sposobów podziału układów cyfrowych. Poniżej podam dwa z nich związane ze sposobem funkcjonowania układów cyfrowych

Bardziej szczegółowo

Badanie układów średniej skali integracji - ćwiczenie Cel ćwiczenia. 2. Wykaz przyrządów i elementów: 3. Przedmiot badań

Badanie układów średniej skali integracji - ćwiczenie Cel ćwiczenia. 2. Wykaz przyrządów i elementów: 3. Przedmiot badań adanie układów średniej skali integracji - ćwiczenie 6. Cel ćwiczenia Celem ćwiczenia jest zapoznanie się z podstawowymi układami SSI (Średniej Skali Integracji). Przed wykonaniem ćwiczenia należy zapoznać

Bardziej szczegółowo

Programowanie niskopoziomowe

Programowanie niskopoziomowe Programowanie niskopoziomowe ASSEMBLER Teodora Dimitrova-Grekow http://aragorn.pb.bialystok.pl/~teodora/ Program ogólny Rok akademicki 2011/12 Systemy liczbowe, budowa komputera, procesory X86, organizacja

Bardziej szczegółowo

Część I - Sterownik przerwań 8259A i zegar/licznik 8253

Część I - Sterownik przerwań 8259A i zegar/licznik 8253 Programowanie na poziome sprzętu opracowanie pytań Część I - Sterownik przerwań 8259A i zegar/licznik 8253 Autor opracowania: Marcin Skiba cines91@gmail.com 1. Jakie są dwie podstawowe metody obsługi urządzeń

Bardziej szczegółowo

PAMIĘCI. Część 1. Przygotował: Ryszard Kijanka

PAMIĘCI. Część 1. Przygotował: Ryszard Kijanka PAMIĘCI Część 1 Przygotował: Ryszard Kijanka WSTĘP Pamięci półprzewodnikowe są jednym z kluczowych elementów systemów cyfrowych. Służą do przechowywania informacji w postaci cyfrowej. Liczba informacji,

Bardziej szczegółowo

dokument DOK 02-05-12 wersja 1.0 www.arskam.com

dokument DOK 02-05-12 wersja 1.0 www.arskam.com ARS3-RA v.1.0 mikro kod sterownika 8 Linii I/O ze zdalną transmisją kanałem radiowym lub poprzez port UART. Kod przeznaczony dla sprzętu opartego o projekt referencyjny DOK 01-05-12. Opis programowania

Bardziej szczegółowo

UKŁADY CYFROWE. Układ kombinacyjny

UKŁADY CYFROWE. Układ kombinacyjny UKŁADY CYFROWE Układ kombinacyjny Układów kombinacyjnych są bramki. Jedną z cech układów kombinacyjnych jest możliwość przedstawienia ich działania (opisu) w postaci tabeli prawdy. Tabela prawdy podaje

Bardziej szczegółowo

Architektura komputerów. Asembler procesorów rodziny x86

Architektura komputerów. Asembler procesorów rodziny x86 Architektura komputerów Asembler procesorów rodziny x86 Architektura komputerów Asembler procesorów rodziny x86 Rozkazy mikroprocesora Rozkazy mikroprocesora 8086 można podzielić na siedem funkcjonalnych

Bardziej szczegółowo

a) dolno przepustowa; b) górno przepustowa; c) pasmowo przepustowa; d) pasmowo - zaporowa.

a) dolno przepustowa; b) górno przepustowa; c) pasmowo przepustowa; d) pasmowo - zaporowa. EUROELEKTRA Ogólnopolska Olimpiada Wiedzy Elektrycznej i Elektronicznej Rok szkolny 2009/2010 Zadania dla grupy elektroniczno-telekomunikacyjnej na zawody I. stopnia 1 Na rysunku przedstawiony jest schemat

Bardziej szczegółowo

interfejs szeregowy wyświetlaczy do systemów PLC

interfejs szeregowy wyświetlaczy do systemów PLC LDN SBCD interfejs szeregowy wyświetlaczy do systemów PLC SEM 08.2003 Str. 1/5 SBCD interfejs szeregowy wyświetlaczy do systemów PLC INSTRUKCJA OBSŁUGI Charakterystyka Interfejs SBCD w wyświetlaczach cyfrowych

Bardziej szczegółowo

UTK ARCHITEKTURA PROCESORÓW 80386/ Budowa procesora Struktura wewnętrzna logiczna procesora 80386

UTK ARCHITEKTURA PROCESORÓW 80386/ Budowa procesora Struktura wewnętrzna logiczna procesora 80386 Budowa procesora 80386 Struktura wewnętrzna logiczna procesora 80386 Pierwszy prawdziwy procesor 32-bitowy. Zawiera wewnętrzne 32-bitowe rejestry (omówione zostaną w modułach następnych), pozwalające przetwarzać

Bardziej szczegółowo

Przetworniki cyfrowo analogowe oraz analogowo - cyfrowe

Przetworniki cyfrowo analogowe oraz analogowo - cyfrowe Przetworniki cyfrowo analogowe oraz analogowo - cyfrowe Przetworniki cyfrowo / analogowe W cyfrowych systemach pomiarowych często zachodzi konieczność zmiany sygnału cyfrowego na analogowy, np. w celu

Bardziej szczegółowo

Asembler - język maszynowy procesora

Asembler - język maszynowy procesora UWAGA! Treść niniejszego dokumentu powstała na podstawie cyklu artykułów pt. Mikrokontrolery? To takie proste zamieszczonych w czasopiśmie Elektronika dla Wszystkich. Asembler - język maszynowy procesora

Bardziej szczegółowo

Standard transmisji równoległej LPT Centronics

Standard transmisji równoległej LPT Centronics Standard transmisji równoległej LPT Centronics Rodzaje transmisji szeregowa równoległa Opis LPT łącze LPT jest interfejsem równoległym w komputerach PC. Standard IEEE 1284 został opracowany w 1994 roku

Bardziej szczegółowo

PAMIĘĆ RAM. Rysunek 1. Blokowy schemat pamięci

PAMIĘĆ RAM. Rysunek 1. Blokowy schemat pamięci PAMIĘĆ RAM Pamięć służy do przechowania bitów. Do pamięci musi istnieć możliwość wpisania i odczytania danych. Bity, które są przechowywane pamięci pogrupowane są na komórki, z których każda przechowuje

Bardziej szczegółowo

Wykład Mikroprocesory i kontrolery

Wykład Mikroprocesory i kontrolery Wykład Mikroprocesory i kontrolery Cele wykładu: Poznanie podstaw budowy, zasad działania mikroprocesorów i układów z nimi współpracujących. Podstawowa wiedza potrzebna do dalszego kształcenia się w technice

Bardziej szczegółowo

Technika mikroprocesorowa I Wykład 3

Technika mikroprocesorowa I Wykład 3 Technika mikroprocesorowa I Wykład 3 Instrukcje wejścia-wyjścia Z80 Odczyt na akumulator danej z urządzenia we-wy o adresie 8-mio bitowym n Odczyt do rejestru r danej z urządzenia we-wy o adresie zawartym

Bardziej szczegółowo

Zastosowania mikrokontrolerów w przemyśle

Zastosowania mikrokontrolerów w przemyśle Zastosowania mikrokontrolerów w przemyśle Cezary MAJ Katedra Mikroelektroniki i Technik Informatycznych Współpraca z pamięciami zewnętrznymi Interfejs równoległy (szyna adresowa i danych) Multipleksowanie

Bardziej szczegółowo

ĆWICZENIE 7. Wprowadzenie do funkcji specjalnych sterownika LOGO!

ĆWICZENIE 7. Wprowadzenie do funkcji specjalnych sterownika LOGO! ćwiczenie nr 7 str.1/1 ĆWICZENIE 7 Wprowadzenie do funkcji specjalnych sterownika LOGO! 1. CEL ĆWICZENIA: zapoznanie się z zaawansowanymi możliwościami mikroprocesorowych sterowników programowalnych na

Bardziej szczegółowo

Ćwiczenie 2. Siedmiosegmentowy wyświetlacz LED

Ćwiczenie 2. Siedmiosegmentowy wyświetlacz LED Ćwiczenie 2 Siedmiosegmentowy wyświetlacz LED 2-1. Cel ćwiczenia Celem ćwiczenia jest zapoznanie się studentów ze sposobem obsługi wielopozycyjnego 7-segmentowego wyświetlacza LED multipleksowanego programowo

Bardziej szczegółowo

Sygnały DRQ i DACK jednego kanału zostały użyte do połączenia kaskadowego obydwu sterowników.

Sygnały DRQ i DACK jednego kanału zostały użyte do połączenia kaskadowego obydwu sterowników. Płyty główne Opracował: Andrzej Nowak Bibliografia: Urządzenia techniki komputerowej, K. Wojtuszkiewicz Układ DMA Układ DMA zawiera dwa sterowniki przerwań 8237A połączone kaskadowo. Każdy sterownik 8237A

Bardziej szczegółowo

1.Wprowadzenie do projektowania układów sekwencyjnych synchronicznych

1.Wprowadzenie do projektowania układów sekwencyjnych synchronicznych .Wprowadzenie do projektowania układów sekwencyjnych synchronicznych.. Przerzutniki synchroniczne Istota działania przerzutników synchronicznych polega na tym, że zmiana stanu wewnętrznego powinna nastąpić

Bardziej szczegółowo

2.1 Porównanie procesorów

2.1 Porównanie procesorów 1 Wstęp...1 2 Charakterystyka procesorów...1 2.1 Porównanie procesorów...1 2.2 Wejścia analogowe...1 2.3 Termometry cyfrowe...1 2.4 Wyjścia PWM...1 2.5 Odbiornik RC5...1 2.6 Licznik / Miernik...1 2.7 Generator...2

Bardziej szczegółowo

Wprowadzenie do informatyki i użytkowania komputerów. Kodowanie informacji System komputerowy

Wprowadzenie do informatyki i użytkowania komputerów. Kodowanie informacji System komputerowy 1 Wprowadzenie do informatyki i użytkowania komputerów Kodowanie informacji System komputerowy Kodowanie informacji 2 Co to jest? bit, bajt, kod ASCII. Jak działa system komputerowy? Co to jest? pamięć

Bardziej szczegółowo

MODBUS RTU wersja M1.14 protokół komunikacyjny wyświetlaczy LDN

MODBUS RTU wersja M1.14 protokół komunikacyjny wyświetlaczy LDN MODBUS RTU wersja M1.14 protokół komunikacyjny do wyświetlaczy SEM 04.2010 Str. 1/5 MODBUS RTU wersja M1.14 protokół komunikacyjny wyświetlaczy LDN W wyświetlaczach LDN protokół MODBUS RTU wykorzystywany

Bardziej szczegółowo

PRZETWORNIK ADC w mikrokontrolerach Atmega16-32

PRZETWORNIK ADC w mikrokontrolerach Atmega16-32 Zachodniopomorski Uniwersytet Technologiczny WYDZIAŁ ELEKTRYCZNY Katedra Inżynierii Systemów, Sygnałów i Elektroniki LABORATORIUM TECHNIKA MIKROPROCESOROWA PRZETWORNIK ADC w mikrokontrolerach Atmega16-32

Bardziej szczegółowo

Proste układy sekwencyjne

Proste układy sekwencyjne Proste układy sekwencyjne Układy sekwencyjne to takie w których niektóre wejścia są sterowany przez wyjściaukładu( zawierają sprzężenie zwrotne ). Układy sekwencyjne muszą zawierać elementy pamiętające

Bardziej szczegółowo

Systemy wbudowane. Uniwersytet Łódzki Wydział Fizyki i Informatyki Stosowanej. Witold Kozłowski

Systemy wbudowane. Uniwersytet Łódzki Wydział Fizyki i Informatyki Stosowanej. Witold Kozłowski Uniwersytet Łódzki Wydział Fizyki i Informatyki Stosowanej Systemy wbudowane Witold Kozłowski Zakład Fizyki i Technologii Struktur Nanometrowych 9-236 Łódź, Pomorska 49/53 https://std2.phys.uni.lodz.pl/mikroprocesory/

Bardziej szczegółowo

Zespół Szkół Technicznych. Badanie wyświetlaczy LCD

Zespół Szkół Technicznych. Badanie wyświetlaczy LCD Zespół Szkół Technicznych Badanie wyświetlaczy LCD WYŚWIETLACZE LCD CZĘSC TEORETYCZNA ZALETY: ) mały pobór mocy, 2) ekonomiczność pod względem zużycia energii (pobór prądu przy 5V mniejszy niż 2mA), 3)

Bardziej szczegółowo

Laboratorium mikroinformatyki. Szeregowe magistrale synchroniczne.

Laboratorium mikroinformatyki. Szeregowe magistrale synchroniczne. Laboratorium mikroinformatyki. Szeregowe magistrale synchroniczne. Transmisja szeregowa charakteryzująca się niewielką ilością linii transmisyjnych może okazać się użyteczna nawet w wypadku zastosowania

Bardziej szczegółowo

ĆWICZENIE. TEMAT: OBSŁUGA PRZETWORNIKA A/C W ukontrolerze 80C535 KEILuVISON

ĆWICZENIE. TEMAT: OBSŁUGA PRZETWORNIKA A/C W ukontrolerze 80C535 KEILuVISON ĆWICZENIE TEMAT: OBSŁUGA PRZETWORNIKA A/C W ukontrolerze 80C535 KEILuVISON Wiadomości wstępne: Wszystkie sygnały analogowe, które mają być przetwarzane w systemach mikroprocesorowych są próbkowane, kwantowane

Bardziej szczegółowo

Lista instrukcji procesora 8051 część 2 Skoki i wywołania podprogramów, operacje na stosie, operacje bitowe

Lista instrukcji procesora 8051 część 2 Skoki i wywołania podprogramów, operacje na stosie, operacje bitowe Lista instrukcji procesora 8051 część 2 Skoki i wywołania podprogramów, operacje na stosie, operacje bitowe Ryszard J. Barczyński, 2009 2013 Politechnika Gdańska, Wydział FTiMS, Katedra Fizyki Ciała Stałego

Bardziej szczegółowo

7. Technika mikroprocesorowa test

7. Technika mikroprocesorowa test 7. Technika mikroprocesorowa test 7.1. Wektor przerwań to: a) adres miejsca w pamięci programu, gdzie znajdują się adresy procedur obsługi przerwań lub ich pierwsze instrukcje b) obszar w pamięci programu

Bardziej szczegółowo

Politechnika Warszawska

Politechnika Warszawska Politechnika Warszawska Wydział Elektryczny Laboratorium Podstaw Techniki Mikroprocesorowej Skrypt do ćwiczenia M.38 Zbieranie pomiarów w czasie rzeczywistym - asembler 1.Wstęp W ćwiczeniach od M.38 do

Bardziej szczegółowo